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Josef Schmid

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    Research interests

    JTAG; Testautomation/Python;Scanaging & SER; robust Design; DFTASIC/FPGA/VHDL; radiation

    About

    11/2007 - heute (2 Jahre) Projektingenieur (Vollzeit, Mit Berufserfahrung) iSyst - intelligente Systeme GmbH, http://www.isyst.de Branche: Andere, 11-50 Mitarbeiter * HIL-Testsysteme (Hardware in the Loop) * Testautomatisierung (Matlab, Simulink, Python) * VHDL & Rapid Prototyping * DFT (ATPG, ATE, JTAG, Scan etc.) * ParaObsol - Obsoleszenz Management * RedunSys - Redundante Systeme (radiation & soft errors) Bearbeiten 2006 - 10/2007 Entwicklungsingenieur (Vollzeit, Mit Berufserfahrung) Alcatel-Lucent, http://www.alcatel-lucent.com Branche: Telekommunikation Börsennotierte AG, 10.001 oder mehr Mitarbeiter ASIC/ASSP/FPGA Design&Test, DFT Items (SCAN; BIST, JTAG), SOC Architectures, Registermap Implementation, Controller Interfaces (CTLID, MPC, RapidIO), Quality Electronic Design, Soft error rate, jtag pinfaking Bearbeiten 1998 - 2006 Entwicklungsing. (Vollzeit, Mit Berufserfahrung) Lucent Technologies, http://www.lucent.com Branche: Telekommunikation, 10.001 oder mehr Mitarbeiter ASIC/ASSP/FPGA Design&Test DFT, SOC architecture Registermap Implementation Controller Interfaces QED, SER, RIO Bearbeiten 1997 - 1997 Entwicklungsing. (Vollzeit, Mit Berufserfahrung) AT&T Branche: Telekommunikation, 10.001 oder mehr Mitarbeiter ASIC Design&Test + Webseite hinzufügen Bearbeiten 1983 - 1996 Entwicklungsingenieur (Vollzeit, Mit Berufserfahrung) Philips Kommunikations Industrie Branche: Telekommunikation, 5001-10.000 Mitarbeiter ASIC Design&Test + Webseite hinzufügen Bearbeiten 10/1981 - 1982 Entwicklungsingenieur (Vollzeit, Berufseinsteiger) TEKADE Branche: Telekommunikation, 1001-5000 Mitarbeiter ASIC Design&Test

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